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기치

AiP2119

AiP2119는 3개의 3상 게이트를 갖춘 고속 3상 게이트 드라이버로, 전력 MOSFET 및 IGBT 소자에 사용됩니다.

독립적인 고측 및 저측 기준 출력 채널. 내장 데드 타임 보호 및 슈트 기능.

보호 회로를 통해 하프 브리지의 손상을 방지합니다. UVLO 회로는 VCC가 0일 때 오작동을 방지합니다.

그리고 VBS는 지정된 임계 전압보다 낮습니다. 새로운 고전압 BCD 프로세스 및

공통 모드 잡음 제거 기술은 높은 dV/dt 조건에서도 하이 사이드 드라이버의 안정적인 작동을 제공합니다.

잡음 환경에서도 우수한 음의 과도 전압 내성을 달성합니다. 활성화 핀(ENB)은 다음과 같습니다.

대기 모드를 사용하여 칩을 낮은 대기 전류 상태로 설정하여 장시간 작동을 구현할 수 있도록 포함되었습니다.

배터리 수명.

 

  • PN :

    AiP2119
  • 공급 전압(V) :

    5.5~16
  • 작동 온도(℃) :

    -40~85
  • 고측 부동 공급 전압-VB(V) :

    90
  • 출력 고단락 펄스 전류(A) :

    1.2
  • 출력 저 단락 펄스 전류(A) :

    2
  • 패키지 :

    TSSOP20/TSSOP24/QFN24

통합형 90V 하프 브리지 하이 사이드 드라이버

내장형 데드 타임 보호 기능

관통 방지

VCC 및 VBS에 대한 저전압 차단

3.3V, 5V 및 15V 입력 로직 호환

대기 전류를 낮추기 위한 활성화 핀(ENB)

IO+/IO-: 1200mA/2000mA

지연 시간: 0.5마이크로초(일반적)

공통 모드 dV/dt 잡음 제거 회로

음의 과도 전압에 대한 내성

노이즈 내성을 향상시키기 위한 낮은 dI/dt 게이트 드라이브

-40°C ~ +85°C 범위로 지정됨

포장 정보: TSSOP20/TSSOP24/QFN24

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AiP2119는 3개의 3상 게이트를 갖춘 고속 3상 게이트 드라이버로, 전력 MOSFET 및 IGBT 소자에 사용됩니다.독립적인 고측 및 저측 기준 출력 채널. 내장 데드 타임 보호 및 슈트 기능.보호 회로를 통해 하프 브리지의 손상을 방지합니다. UVLO 회로는 VCC가 0일 때 오작동을 방지합니다.그리고 VBS는 지정된 임계 전압보다 낮습니다. 새로운 고전압 BCD 프로세스 및공통 모드 잡음 제거 기술은 높은 dV/dt 조건에서도 하이 사이드 드라이버의 안정적인 작동을 제공합니다.잡음 환경에서도 우수한 음의 과도 전압 내성을 달성합니다. 활성화 핀(ENB)은 다음과 같습니다.대기 모드를 사용하여 칩을 낮은 대기 전류 상태로 설정하여 장시간 작동을 구현할 수 있도록 포함되었습니다.배터리 수명. 

세부

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